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Les deux regroupements figurant dans ce tableau permettent de trouver l'équation logique de S suivante: S = J + Q En utilisant des portes NAND, le circuit combinatoire suivant (figure 33) peut fournir le signal S: 3. 3. - EXAMEN DES QUATRE MODES DE FONCTIONNEMENT D'APRÈS LA TABLE DE VÉRITÉ DE LA FIGURE 31-a Si J = 0 et K = 0, alors S = D = Q. Cela signifie que l'état logique présent en D est le même que celui de la sortie Q. Il ne peut donc y avoir de basculement au moment du front actif de l'horloge et l'état des sorties Q et reste inchangé. Si J = 0 et K = 1, alors S = D = 0. Cours bascule jk capital management la. L'état logique que mémorise la bascule JK lors du front actif de l'horloge est l'état logique 0. C'est la remise à 0 de la bascule qui s'effectue donc de façon synchrone par opposition à l'entrée CLEAR qui elle, est prioritaire et asynchrone. Si J = 1 et K = 0, alors S = D = 1. L'état logique que mémorise la bascule JK lors du front actif de l'horloge est l'état logique 1. C'est la remise à 1 de la bascule qui est également synchrone.
Bascule JK Maître Esclave: 3. - BASCULE JK MAÎTRE ESCLAVE 3. 1. - REPRÉSENTATION SYMBOLIQUE La bascule JK MAÎTRE ESCLAVE est une autre bascule de type MAÎTRE ESCLAVE. Comme le montre la figure 29, la bascule JK possède deux entrées notées J et K alors que la bascule D MAÎTRE ESCLAVE n'en possède qu'une seule. On retrouve l'entrée d'horloge CLOCK, les entrées de remise à 0 et de remise à 1 CLEAR et PRESET et les sorties complémentaires Q et de la bascule D MAÎTRE ESCLAVE. 3. 2. COURS AUTOMATISME I (Mr KHATORY) - B. BASCULE JK. - STRUCTURE ET PRINCIPE DE FONCTIONNEMENT est élaborée à partir d'une bascule D MA Î TRE ESCLAVE. Il suffit d'ajouter un réseau combinatoire sur l'entrée D (voir figure 30) pour obtenir la bascule JK. En fonction de l'état des entrées J et K, la sortie S du réseau combinatoire reliée à l'entrée D de la bascule D MAÎTRE ESCLAVE présente l'un des quatre états indiqués à la figure 31-a. On est conduit à la table de vérité de la figure 31-b qui donne l'état logique de S en fonction des combinaisons possibles des états logiques des entrées J, K et Q. Dressons le tableau de Karnaugh (figure 32) pour trouver l'équation la plus simple de S.
Quand les entrées J et K ne valent pas toutes les deux "1", avec le schéma utilisé il est parfois nécessaire d'agir une fois sur l'horloge pour obtenir des sorties stables. Table de vérité de la bascule J-K
La figure 37 illustre le temps de prépositionnement ( t set up) lorsque la donnée à mémoriser est au niveau L. V ref correspond à la tension de basculement des portes du circuit: V ref = 1, 5 V en technologie TTL tandard. V ref = 1, 3 V en technologie TTL - LS. V ref = VDD / 2 en technologie, VDD étant la tension d'alimentation du circuit. La figure 38 illustre le temps de prépositionnement lorsque la donnée à mémoriser est au niveau H. Les deux chronogrammes des figures 37 et 38 sont souvent réunis en un seul dans les catalogues de constructeurs, comme le montre la figure 39. Les périodes hachurées indiquent que la donnée peut varier d'un niveau à l'autre sans qu'il y ait d'influence sur le comportement du circuit. 4. Cours bascule jk 1. - TEMPS DE MAINTIEN ( HOLD TIME EN ANGLAIS) D'UNE DONNÉE SUR UNE ENTRÉE DÉPENDANTE DE L'HORLOGE Le temps de maintien est le temps minimal pendant lequel la donnée présente sur l'entrée doit rester stable après le front actif de l'horloge pour que cette donnée soit reconnue.
Pour J=K=1, le système bascule à chaque front. Pour J différent de K, Q recopie la valeur de J et recopie la valeur de K. Il est interdit de mettre en même temps PR et CLR à 0. Table de vérité: J K H Q(n) 0 Q(n-1) 1 (n-1)
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